繁體：鎖存電路
锁存电路是一种基本的数字存储元件，用于存储单个数据位。
锁存电路是一种基本的数字存储元件，用于存储单个数据位。在感测放大器应用中，它在读取操作期间捕获并保持来自存储单元（如DRAM或SRAM）的放大信号，防止在后续处理过程中数据丢失。它由交叉耦合的逻辑门（通常是NAND或NOR）组成，形成双稳态，即使在输入改变后也能保持输出，直到施加复位信号。 基于双稳态多谐振荡器原理，利用正反馈工作。当使能时，它采样来自感测放大器的输入信号，并将其锁定在两个稳定状态（高或低）之一。无论输入如何变化，输出保持锁存，直到复位或使能信号切换它。在感测放大器中，通常使用SR（置位-复位）或D型锁存配置来捕获从存储单元读取的电压差。
该组件会出现在以下整机或工业产品中。
诱因 → 失效模式 → 工程缓解
不是客户评论，也不是实时热度。以下维度用于前期 RFQ 准备和供应商评估。
这些分值是采购评估维度示例，不代表真实客户评分、具体国家买家反馈或实时询盘。
锁存器是电平敏感的，使能时透明；而触发器是边沿触发的。在感测放大器中，锁存器通常更受欢迎，因为可以在放大窗口内更快地捕获信号，而触发器则在时钟边沿提供同步时序。
它通过保持放大的信号稳定来防止数据损坏，减少时序约束，并支持存储器系统中的异步读操作。
亚稳态问题、建立/保持时间违规、低功耗模式下的漏电流，以及高频操作下互连中的电迁移。
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