行业组件数据 · 2026

引线框架/基板

引线框架或基板是半导体封装中的结构组件，作为集成电路芯片与外部电路板之间的接口。

技术定义与适配语境
典型 引线框架/基板 会按材料、尺寸公差、适配关系和失效风险在 计算机、电子和光学产品制造 中评估。

引线框架或基板是半导体封装中的结构组件，作为集成电路芯片与外部电路板之间的接口。它通过导电迹线提供电气通路，为芯片提供机械支撑，并具备散热能力。引线框架通常由金属合金制成，用于传统封装；而基板通常是多层有机或陶瓷结构，用于BGA和倒装芯片等先进封装技术。 引线框架/基板通过提供图案化的导电框架，将半导体芯片的焊盘连接到外部引脚或焊球。电信号从芯片通过引线键合或焊料凸点传输到引线框架/基板的迹线，然后路由到外部连接。它还作为芯片贴装和封装的机械平台，以及有源器件散热的导热路径。

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组件规格

定义
引线框架或基板是半导体封装中的结构组件，作为集成电路芯片与外部电路板之间的接口。它通过导电迹线提供电气通路，为芯片提供机械支撑，并具备散热能力。引线框架通常由金属合金制成，用于传统封装；而基板通常是多层有机或陶瓷结构，用于BGA和倒装芯片等先进封装技术。

引线框架/基板通过提供图案化的导电框架，将半导体芯片的焊盘连接到外部引脚或焊球。电信号从芯片通过引线键合或焊料凸点传输到引线框架/基板的迹线，然后路由到外部连接。它还作为芯片贴装和封装的机械平台，以及有源器件散热的导热路径。
工作原理
The leadframe/substrate functions by providing a patterned conductive framework that connects the bond pads of the semiconductor die to external pins or balls. Electrical signals travel from the die through wire bonds or solder bumps to the leadframe/substrate traces, which then route them to external connections. It also serves as a mechanical platform for die attachment and encapsulation, and as a thermal path for heat dissipation from the active device.
材料
铜合金（C194、C7025）、合金42（Fe-42Ni）、可伐合金（Fe-Ni-Co）、铝、陶瓷（Al2O3、AlN）、有机基板（FR-4、BT树脂、聚酰亚胺）电镀选项包括银、金、镍-钯-金和锡。
CTE
4-18 ppm/°C
Pitch
0.3mm to 1.27mm
Thickness
0.1mm to 0.25mm
Lead Count
8 to 1000+
Die Pad Size
Custom to die dimensions
Package Size
2mm x 2mm to 50mm x 50mm
Thermal Conductivity
200-400 W/mK for metal, 20-200 W/mK for ceramic
标准
ISO 9001JEDEC JESD22IPC-6012MIL-PRF-38535

行业分类与别名

引线框架/基板 的常用贸易名称、技术标识和检索关键词。

semiconductor leadframeIC substratepackaging componentdie attachwire bondingBGA substrateflip-chip packagingthermal management引线框架/基板Leadframe / Substrate计算机、电子和光学产品制造 引线框架/基板

上级产品

该组件会出现在以下整机或工业产品中。

封装
三轴陀螺仪芯片的保护外壳与电气接口。
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FMEA · 风险与缓解

诱因 → 失效模式 → 工程缓解

CTE mismatch between materials->Cracking or delamination during thermal cycling->Material selection with matched CTE, stress-relief designs, underfill application
Contamination on bonding surfaces->Poor wire bond or solder joint integrity->Cleanroom handling, surface plating, pre-bond cleaning processes
Insufficient thermal dissipation->Device overheating and premature failure->Thermal vias, heat spreaders, material selection with high thermal conductivity

工业生态与工程逻辑

兼容对象
Die bondersWire bondersMolding pressesSMT placement equipmentAutomated optical inspection systems
可替换件
Mitsui High-tecShinko ElectricASE GroupJCET GroupAmkor TechnologyIbidenUnimicron
0
CTE mismatch causing thermal stress
1
delamination during reflow
2
corrosion in humid environments
3
wire bond lift-off
4
solder joint fatigue

合规与检测

tolerance
±0.02mm for critical dimensions, ±0.05mm for general features
test method
X-ray inspection for internal defects, cross-section analysis, thermal cycling (-55°C to 150°C), humidity testing (85°C/85% RH), shear and pull tests for bond integrity

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采购评估维度

不是客户评论，也不是实时热度。以下维度用于前期 RFQ 准备和供应商评估。

技术文档
4/5
制造能力
4/5
可检验性
5/5
供应商透明度
3/5

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常见问题

What is the difference between leadframe and substrate?

Leadframes are single-layer metal frames used in traditional packages like QFP and SOIC, while substrates are multilayer structures (organic or ceramic) used in advanced packages like BGA and CSP that require higher density interconnections.

What materials are commonly used for leadframes?

Copper alloys (C194, C7025) are most common for their conductivity and cost, while Alloy 42 and Kovar are used when CTE matching to silicon is critical. Plating with silver, gold, or NiPdAu provides bondable surfaces.

How does substrate design affect package performance?

Substrate design impacts electrical performance (impedance control, signal integrity), thermal management (heat spreading), mechanical reliability (warpage control), and miniaturization capabilities through multilayer routing.

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URN:CNFX:ME:UNIT:LEADFRAME_SUBSTRATE